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本書深入淺出地介紹Verilog硬體描述語言的特性，以及電腦輔助設計工具(CAD)。
Verilog語言是一種一般性的硬體描述語言，它的語法與C語言相似，易學易用。本書是以邏輯合成的方式寫成的，可讓剛開始使用Verilog來 設計數位電路的新手們，用起來很上手。
本書目的在於藉由學習Verilog語言的過程中去瞭解硬體描述語言的設計概念，進而完成設計數位晶片的最終目標。本版新增資料驗證電路，且增強Verilog 2001特色。
第一章 數位電路的設計觀念
第二章 Verilog硬體描述語言簡介
第三章 Verilog的模組與架構
第四章 能否用於電路合成的Verilog語法
第五章 Verilog的敘述
第六章 Verilog電路設計的基本觀念
第七章 算術運算
第八章 組合邏輯電路與簡易的算術邏輯運算
第九章 循序邏輯電路
第十章 有限狀態機器
第十一章 進階設計概念
第十二章 記憶體設計與應用
第十三章 資料驗證電路
第十四章 Verilog 2001增強特色
第十五章 Verilog的檔案處理與除錯輔助功能
第十六章 User Defined Primitives
附錄Ａ Verilog的識別字（Keywords）
